Auszug aus dem Forum:
"An dieser Stelle eine Anmerkung zu einem Bug in Sigma Studio, den ich gerade gefunden habe:Viele (vermutlich die Meisten) Geräte wollen den I²S bitclock (bclk oder sclk) so, dass die Daten auf der steigenden Flanke (genau in der Mitte der BCLK-Periode)..."» Weiterlesen: Der Sure DSP Thread
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